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      基于fpga的視頻監(jiān)控系統(tǒng)的制作方法

      文檔序號(hào):7785385閱讀:263來(lái)源:國(guó)知局
      基于fpga的視頻監(jiān)控系統(tǒng)的制作方法
      【專利摘要】基于FPGA的視頻監(jiān)控系統(tǒng)。目前的監(jiān)控多以PC機(jī)為主,只是起到簡(jiǎn)單的監(jiān)控、記錄功能。PC機(jī)需要配備大容量的硬盤來(lái)保存數(shù)據(jù),一般的監(jiān)控視頻保留時(shí)間短。本實(shí)用新型的組成包括:無(wú)線網(wǎng)絡(luò)攝像機(jī)(1)、紅外網(wǎng)絡(luò)攝像機(jī)(2)、網(wǎng)絡(luò)半球攝像機(jī)(3)、網(wǎng)絡(luò)高速智能球攝像機(jī)(4),其特征是:所述的網(wǎng)絡(luò)半球攝像機(jī)、所述的網(wǎng)絡(luò)高速智能球攝像機(jī)分別與解碼器(5)連接,所述的解碼器、所述的無(wú)線網(wǎng)絡(luò)攝像機(jī)、所述的紅外網(wǎng)絡(luò)攝像機(jī)分別與圖像采集裝置(6)連接,所述的圖像采集裝置與圖像處理裝置(7)連接,所述的圖像處理裝置與視頻矩陣分配器(8)連接,所述的視頻矩陣分配器與監(jiān)控終端裝置(9)連接。本實(shí)用新型用于視頻監(jiān)控。
      【專利說(shuō)明】基于FPGA的視頻監(jiān)控系統(tǒng)
      [0001]【技術(shù)領(lǐng)域】:
      [0002]本實(shí)用新型涉及一種基于FPGA的視頻監(jiān)控系統(tǒng)。
      [0003]【背景技術(shù)】:
      [0004]隨著人們生活水平的提高以及安全防范意識(shí)的加強(qiáng),視頻監(jiān)控系統(tǒng)近年來(lái)得到了廣泛的應(yīng)用。然而,目前的監(jiān)控多以PC機(jī)為主,只是起到簡(jiǎn)單的監(jiān)控、記錄功能。監(jiān)控中心需要有專人值守,長(zhǎng)時(shí)間的監(jiān)視屏幕容易產(chǎn)生視覺(jué)疲勞。而且,PC機(jī)需要配備大容量的硬盤來(lái)保存數(shù)據(jù),一般的監(jiān)控視頻保留時(shí)間短,只能保留一個(gè)月左右的時(shí)間,有的甚至更短。
      [0005]
      【發(fā)明內(nèi)容】
      :
      [0006]本實(shí)用新型的目的是提供一種基于FPGA的視頻監(jiān)控系統(tǒng)。
      [0007]上述的目的通過(guò)以下的技術(shù)方案實(shí)現(xiàn):
      [0008]一種基于FPGA的視頻監(jiān)控系統(tǒng),其組成包括:無(wú)線網(wǎng)絡(luò)攝像機(jī)、紅外網(wǎng)絡(luò)攝像機(jī)、網(wǎng)絡(luò)半球攝像機(jī)、網(wǎng)絡(luò)高速智能球攝像機(jī),所述的網(wǎng)絡(luò)半球攝像機(jī)、所述的網(wǎng)絡(luò)高速智能球攝像機(jī)分別與解碼器連接,所述的解碼器、所述的無(wú)線網(wǎng)絡(luò)攝像機(jī)、所述的紅外網(wǎng)絡(luò)攝像機(jī)分別與圖像采集裝置連接,所述的圖像采集裝置與圖像處理裝置連接,所述的圖像處理裝置與視頻矩陣分配器連接,所述的視頻矩陣分配器與監(jiān)控終端裝置連接。
      [0009]所述的基于FPGA的視頻監(jiān)控系統(tǒng),所述的圖像處理裝置包括殼體,所述的殼體內(nèi)部具有現(xiàn)場(chǎng)可編程邏輯門陣列元件,所述的現(xiàn)場(chǎng)可編程邏輯門陣列元件與中央處理器連接,所述的中央處理器與數(shù)據(jù)存儲(chǔ)器、程序存儲(chǔ)器、ATA硬盤、報(bào)警裝置、以太網(wǎng)接口電路、顯示電路、電源電路連接,所述的顯示電路與安裝在所述的殼體上的顯示屏連接。
      [0010]有益效果:
      [0011]本實(shí)用新型的中央處理器是采用專用多媒體芯片TMS320DM642 (簡(jiǎn)稱DM642),用于接收、處理視頻和音頻數(shù)據(jù),系統(tǒng)功能擴(kuò)展十分方便。此外,DM642自帶的EMAC 口以及從EMTF 口擴(kuò)展出來(lái)的ATA 口,還為處理完成后產(chǎn)生的海量數(shù)據(jù)提供了存儲(chǔ)通道。
      [0012]本實(shí)用新型上電或復(fù)位后,從程序存儲(chǔ)器加載程序,完成對(duì)芯片的初始化和外圍硬件的配置等工作,之后便開始進(jìn)行圖像采集。從攝像頭采集到的模擬視頻信號(hào)經(jīng)過(guò)視頻解碼器轉(zhuǎn)換為數(shù)字視頻信號(hào),送入DM642的視頻通道(VP端口)。在檢測(cè)到有人進(jìn)入監(jiān)視區(qū)域時(shí),啟動(dòng)錄像功能,DM642將接收到的數(shù)字視頻信號(hào)和數(shù)字音頻信號(hào)用MPEG4標(biāo)準(zhǔn)編碼壓縮,以文件的格式存儲(chǔ)到本地ATA硬盤,供日后調(diào)用。同時(shí)采集人臉圖像并進(jìn)行身份識(shí)別,如有異常則啟動(dòng)報(bào)警程序。
      [0013]現(xiàn)場(chǎng)可編程邏輯門陣列元件FPGA的功能主要是實(shí)現(xiàn)系統(tǒng)的邏輯控制以及存儲(chǔ)器的時(shí)序控制。為實(shí)現(xiàn)圖像的實(shí)時(shí)采集和處理,需要視頻的轉(zhuǎn)換和圖像的處理并行工作。利用現(xiàn)場(chǎng)可編程邏輯門陣列元件FPGA內(nèi)部資源構(gòu)建高速雙口 RAM,使數(shù)據(jù)幀處理交替進(jìn)行,從而實(shí)現(xiàn)數(shù)據(jù)采集與處理同時(shí)進(jìn)行?,F(xiàn)場(chǎng)可編程邏輯門陣列元件FPGA采用EP1C3T144,其讀取速度達(dá)200MHz,足以滿足數(shù)據(jù)處理的要求。FPGA配置采用了專用配置芯片EPCSl。
      [0014]【專利附圖】

      【附圖說(shuō)明】:
      [0015]附圖1是本實(shí)用新型的結(jié)構(gòu)示意圖。[0016]附圖2是附圖1中圖像處理裝置的結(jié)構(gòu)示意圖。
      [0017]【具體實(shí)施方式】:
      [0018]實(shí)施例1:
      [0019]一種基于FPGA的視頻監(jiān)控系統(tǒng),其組成包括:無(wú)線網(wǎng)絡(luò)攝像機(jī)1、紅外網(wǎng)絡(luò)攝像機(jī)
      2、網(wǎng)絡(luò)半球攝像機(jī)3、網(wǎng)絡(luò)高速智能球攝像機(jī)4,所述的網(wǎng)絡(luò)半球攝像機(jī)、所述的網(wǎng)絡(luò)高速智能球攝像機(jī)分別與解碼器5連接,所述的解碼器、所述的無(wú)線網(wǎng)絡(luò)攝像機(jī)、所述的紅外網(wǎng)絡(luò)攝像機(jī)分別與圖像采集裝置6連接,所述的圖像采集裝置與圖像處理裝置7連接,所述的圖像處理裝置與視頻矩陣分配器8連接,所述的視頻矩陣分配器與監(jiān)控終端裝置9連接。
      [0020]實(shí)施例2:
      [0021]根據(jù)實(shí)施例1所述的基于FPGA的視頻監(jiān)控系統(tǒng),所述的圖像處理裝置包括殼體10,所述的殼體內(nèi)部具有現(xiàn)場(chǎng)可編程邏輯門陣列元件11,所述的現(xiàn)場(chǎng)可編程邏輯門陣列元件與中央處理器12連接,所述的中央處理器與數(shù)據(jù)存儲(chǔ)器13、程序存儲(chǔ)器14、ATA硬盤15、報(bào)警裝置16、以太網(wǎng)接口電路17、顯示電路18、電源電路19連接,所述的顯示電路與安裝在所述的殼體上的顯示屏連接。
      【權(quán)利要求】
      1.一種基于FPGA的視頻監(jiān)控系統(tǒng),其組成包括:無(wú)線網(wǎng)絡(luò)攝像機(jī)、紅外網(wǎng)絡(luò)攝像機(jī)、網(wǎng)絡(luò)半球攝像機(jī)、網(wǎng)絡(luò)高速智能球攝像機(jī),其特征是:所述的網(wǎng)絡(luò)半球攝像機(jī)、所述的網(wǎng)絡(luò)高速智能球攝像機(jī)分別與解碼器連接,所述的解碼器、所述的無(wú)線網(wǎng)絡(luò)攝像機(jī)、所述的紅外網(wǎng)絡(luò)攝像機(jī)分別與圖像采集裝置連接,所述的圖像采集裝置與圖像處理裝置連接,所述的圖像處理裝置與視頻矩陣分配器連接,所述的視頻矩陣分配器與監(jiān)控終端裝置連接。
      2.根據(jù)權(quán)利要求1所述的基于FPGA的視頻監(jiān)控系統(tǒng),其特征是:所述的圖像處理裝置包括殼體,所述的殼體內(nèi)部具有現(xiàn)場(chǎng)可編程邏輯門陣列元件,所述的現(xiàn)場(chǎng)可編程邏輯門陣列元件與中央處理器連接,所述的中央處理器與數(shù)據(jù)存儲(chǔ)器、程序存儲(chǔ)器、ATA硬盤、報(bào)警裝置、以太網(wǎng)接口電路、顯示電路、電源電路連接,所述的顯示電路與安裝在所述的殼體上的顯示屏連接。
      【文檔編號(hào)】H04N7/18GK203406967SQ201320514507
      【公開日】2014年1月22日 申請(qǐng)日期:2013年8月22日 優(yōu)先權(quán)日:2013年8月22日
      【發(fā)明者】蔣本天 申請(qǐng)人:哈爾濱師范大學(xué)
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