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      讀等待時間控制電路的制作方法技術(shù)資料下載

      技術(shù)編號:6757912

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      本發(fā)明涉及一種用于初始化一個讀等待時間的方法以及電路布置,其特別用于DDR圖形存儲器中。雖然能用于任意的半導體存儲器,但以下將關(guān)于DDR半導體存儲器、并且這里特別關(guān)于圖形存儲器,說明本發(fā)明及本發(fā)明所涉及的問題。在現(xiàn)代計算機和軟件應用中對在更短的時間內(nèi)處理更大的數(shù)據(jù)量的需求迅速增加。使用例如DRAM存儲器的大規(guī)模集成存儲器來存儲數(shù)據(jù)。在這樣的半導體存儲器,特別是在例如DRAM存儲器的動態(tài)讀寫存儲器的制造中,使用了各種實施例以及變型,各個實施例由于其各自操作特...
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