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技術(shù)編號(hào)：7521000

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本發(fā)明涉及PLL (Wiase Locked Loop 鎖相環(huán))電路，特別是涉及無(wú)需使噪聲特性劣化、就能抑制消耗電力而提高可靠性的PLL電路。背景技術(shù)[以往的PLL電路圖9]參照?qǐng)D9對(duì)以往的PLL電路進(jìn)行說(shuō)明。圖9是以往的PLL電路的結(jié)構(gòu)圖。如圖9所示，以往的PLL電路由以下部分構(gòu)成VC0(VoltageControlled Oscillator 電壓控制振蕩器)1、PLL IC(PLL IntegratedCircuit 相位比較單元)2、模擬濾波器3、...
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該專(zhuān)利適合技術(shù)人員進(jìn)行技術(shù)研發(fā)參考以及查看自身技術(shù)是否侵權(quán)，增加技術(shù)思路，做技術(shù)知識(shí)儲(chǔ)備，不適合論文引用。
該類(lèi)技術(shù)注重原理思路，無(wú)完整電路圖，適合研究學(xué)習(xí)。

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