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      一種抗噪聲的延遲計數(shù)器的制造方法技術(shù)資料下載

      技術(shù)編號:8771489

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      計算機以及各種電子設(shè)備廣泛的應(yīng)用于現(xiàn)代生活的各個方面,對內(nèi)存產(chǎn)品(DRAM存儲器)需求越來越大。人們對速度要求越來越快,存儲器的時鐘就越來越小。所以噪聲對產(chǎn)品性能的影響越來越大。存儲器的延遲計數(shù)器是用來實現(xiàn)存儲器的讀指令的。每當一個讀指令,用戶期望在一個固定延遲周期(用戶可以配置)后的時鐘上升沿得到期望的數(shù)據(jù),如圖1所示為DRAM存儲器讀指令操作示意圖,圖中延遲周期為6。為了實現(xiàn)上述讀操作,DRAM存儲器一般分3步完成Step A存儲器接受外部讀指令,產(chǎn)生...
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