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      顯示裝置的制造方法_3

      文檔序號:9922647閱讀:來源:國知局
      、鋅(Zn)、鎵(Ga)、錫(Sn)或銦(In)的氧化物以及作為它們的復(fù)合氧化物的氧化銦鎵鋅(InGaZn04)、氧化銦鋅(ZnInO)、氧化鋅錫(ZnSnO)、氧化銦鎵(InGaO)、氧化銦錫(InSnO)、氧化銦鋯(InZrO)、氧化銦鋯鋅(In-Zr-Zn-O)、氧化銦鋯錫(InZrSnO)、氧化銦鋯鎵(InZrGaO)、氧化銦鋁(InAlO)、氧化銦鋅鋁(InZnAlO)、氧化銦錫鋁(InSnAlO)、氧化銦鋁鎵(InAlGaO)、氧化銦鉭(InTaO)、氧化銦鉭鋅(InTaZnO)、氧化銦鉭錫(InTaSnO)、氧化銦鉭鎵(InTaGaO)、氧化銦鍺(InGeO)、氧化銦鍺鋅(InGeZnO)、氧化銦鍺錫(InGeSnO)、氧化銦鍺鎵(InGeGaO)、氧化鈦銦鋅(TiInZnO)和氧化鉿銦鋅(HfInZnO)中選擇的至少一種。
      [0061]半導(dǎo)體層包括未摻雜雜質(zhì)的溝道區(qū)以及形成在溝道區(qū)的兩側(cè)處的摻雜雜質(zhì)的源區(qū)和漏區(qū)。這里,雜質(zhì)根據(jù)薄膜晶體管的類型而改變,并且可以是N型雜質(zhì)或P型雜質(zhì)。
      [0062]在半導(dǎo)體層包括氧化物半導(dǎo)體或由氧化物半導(dǎo)體形成的示例性實(shí)施例中,可加入單獨(dú)的鈍化層以保護(hù)氧化物半導(dǎo)體免受外部環(huán)境(例如在高溫下暴露)的影響。
      [0063]液晶電容器Clc的兩個端子可通過下面板10的像素電極PE和共電極CE來限定,在像素電極PE與共電極CE之間的液晶層15用作液晶電容器Clc的介電材料。液晶層15具有介電各向異性。像素電壓通過像素電極PE與共電極CE之間的電壓差來確定。
      [0064]像素電極PE連接到開關(guān)元件Q。共電極CE接收共電壓Vcom。共電極CE可設(shè)置在上面板20的整個表面上。在可選擇的示例性實(shí)施例中,共電極CE可設(shè)置在下面板10上。在這樣的實(shí)施例中,像素電極PE和共電極CE中的至少一個可具有線型形狀或桿形狀。
      [0065]充當(dāng)液晶電容器Clc的從屬角色的存儲電容器Cst通過包括在下面板10中的單獨(dú)的信號線(未示出)和像素電極PE的疊置部分來限定且絕緣體位于它們之間,諸如共電壓Vcom的預(yù)定電壓可施加到單獨(dú)的信號線。
      [0066]在示例性實(shí)施例中,如圖2所示,濾色器CF可設(shè)置在上面板20上??蛇x擇地,濾色器CF可設(shè)置在下面板10的像素電極PE上或設(shè)置在下面板10的像素電極PE下面。每個像素PX唯一地顯示原色中的一種,并且期望的顏色可通過原色的空間總和來識別。每個像素PX可隨時間交替地顯示原色,期望的顏色可通過原色的暫時總和來識別。在一個示例性實(shí)施例中,例如,原色可包括紅色、綠色和藍(lán)色的三原色。
      [0067]圖3是根據(jù)本發(fā)明的顯示裝置的柵極驅(qū)動器的示例性實(shí)施例的框圖。
      [0068]參照圖3,柵極驅(qū)動器200的示例性實(shí)施例包括多個柵極驅(qū)動塊210[1]至210 [η] ο相應(yīng)的柵極驅(qū)動塊210 [I]至210 [η]接收輸入信號以產(chǎn)生分別輸出到多條柵極線Sl-Sn的柵極信號S[I]至S[n]。
      [0069]這里,為了便于說明和描述,主要示出了輸入到第i柵極驅(qū)動塊210[i]的輸入信號,輸入到其他柵極驅(qū)動塊的信號在圖3中僅示出為時鐘信號CKsl至CKs8。
      [0070]以下,為了便于描述,將詳細(xì)地描述柵極驅(qū)動塊,例如,第i柵極驅(qū)動塊210 [i]。
      [0071]在示例性實(shí)施例中,輸入到柵極驅(qū)動塊210[i]的信號包括兩個時鐘信號(例如,八個時鐘信號(例如第一時鐘信號CKsl至第八時鐘信號CKs8)中的第一時鐘信號CKsl和第五時鐘信號CKs5)、正向驅(qū)動信號DIRs和反向驅(qū)動信號DIRBs。在這樣的實(shí)施例中,柵極驅(qū)動塊210[i]接收其第四先前柵極驅(qū)動塊210[1-4]的輸出信號S[1-4]、其第一先前柵極驅(qū)動塊210[1-l]的輸出信號S [1-1]、其第一隨后柵極驅(qū)動塊210 [i+1]的輸出信號S[i+1]以及其第四隨后柵極驅(qū)動塊210[i+4]的輸出信號S[i+4]。
      [0072]在示例性實(shí)施例中,當(dāng)柵極驅(qū)動器200處于正向驅(qū)動時,即,當(dāng)處于柵極導(dǎo)通電壓電平的柵極信號s[l]至S[n]沿正向方向順序地從柵極驅(qū)動器200輸出時,可在高電平電壓下施加正向驅(qū)動信號DIRs,并且可在低電平電壓下施加反向驅(qū)動信號DIRBs。
      [0073]在示例性實(shí)施例中,當(dāng)柵極驅(qū)動器200處于反向驅(qū)動時,即,當(dāng)處于柵極導(dǎo)通電壓電平的柵極信號s[l]至S[n]沿反向方向順序地從柵極驅(qū)動器200輸出時,可在低電平電壓下施加正向驅(qū)動信號DIRs,并且可在高電平電壓下施加反向驅(qū)動信號DIRBs。
      [0074]第一時鐘信號CKsl的電壓電平可按每個水平周期IH交替地變化為高電平電壓和低電平電壓。第二時鐘信號CKs2是第一時鐘信號CKsl移位了 1/4H的時鐘信號。第三時鐘信號CKs3是第二時鐘信號CKs2移位了 1/4H的時鐘信號。第四時鐘信號CKs4是第三時鐘信號CKs3移位了 1/4H的時鐘信號。第五時鐘信號CKs5是第四時鐘信號CKs4移位了1/4H的時鐘信號。第六時鐘信號CKs6是第五時鐘信號CKs5移位了 1/4H的時鐘信號。第七時鐘信號CKs7是第六時鐘信號CKs6移位了 1/4H的時鐘信號。第八時鐘信號CKs8是第七時鐘信號CKs7移位了 1/4H的時鐘信號。
      [0075]第五時鐘信號CKs5變成第一時鐘信號CKsl的反向時鐘信號。因此,在這樣的實(shí)施例中,如在圖3中所示,兩個時鐘信號(其中一個與另一個反向)被輸入到多個柵極驅(qū)動塊210 [I] S 210 [η]中的每個。
      [0076]來自柵極驅(qū)動塊210[i]的第四先前柵極驅(qū)動塊210[1-4]的處于柵極導(dǎo)通電壓電平的輸出信號S[1-4]可比來自柵極驅(qū)動塊210[i]的處于柵極導(dǎo)通電壓電平的輸出信號S[i]提早IH輸出。來自柵極驅(qū)動塊210[i]的第一先前柵極驅(qū)動塊210[1-1]的處于柵極導(dǎo)通電壓電平的輸出信號S[1-1]可比來自柵極驅(qū)動塊210[i]的處于柵極導(dǎo)通電壓電平的輸出信號s[i]提早第一時段或第一相位(例如,1/4H)輸出。來自柵極驅(qū)動塊210[i]的第一隨后柵極驅(qū)動塊210[i+l]的處于柵極導(dǎo)通電壓電平的輸出信號S[i+1]可比來自柵極驅(qū)動塊210[i]的處于柵極導(dǎo)通電壓電平的輸出信號S[i]推遲1/4H輸出。來自柵極驅(qū)動塊210[i]的第四隨后柵極驅(qū)動塊210[i+4]的處于柵極導(dǎo)通電壓電平的輸出信號S[i+4]可比來自柵極驅(qū)動塊210[i]的處于柵極導(dǎo)通電壓電平的輸出信號S[i]推遲第二時間段或第二相位(例如,1H)輸出。
      [0077]以下,將參照圖4和圖5更詳細(xì)地描述包括在多個柵極驅(qū)動塊210[I]至210[η]中的每個中的柵極驅(qū)動電路的示例性實(shí)施例及其操作。
      [0078]圖4是根據(jù)本發(fā)明的顯示裝置的柵極驅(qū)動塊的柵極驅(qū)動電路的示例性實(shí)施例的電路圖。圖5是示出根據(jù)本發(fā)明的顯示裝置的柵極驅(qū)動電路的示例性實(shí)施例的操作的信號時序圖。
      [0079]參照圖4,柵極驅(qū)動塊210[i]的柵極驅(qū)動電路的示例性實(shí)施例包括多個輸入端子DIR、DIRB、CK、CKB、Cr [1-4]、Cr [i_l]、Cr [i+1]和 Cr [i+4]、輸出端子 OUT、多個晶體管(例如,第一晶體管Ml至第十晶體管M10)以及電容器Cl。在這樣的實(shí)施例中,多個輸入端子包括正向驅(qū)動輸入端子DIR、反向驅(qū)動輸入端子DIRB、第一時鐘信號輸入端子CK、第二時鐘信號輸入端子CKB、第一正向輸入端子Cr [1-Ι]、第二正向輸入端子Cr [1-4]、第一反向輸入端子Cr [i+Ι]和第二反向輸入端子Cr [i+4]。輸出端子OUT連接到柵極線。
      [0080]在這樣的實(shí)施例中,第一晶體管Ml包括連接到第一節(jié)點(diǎn)Ql的柵電極、連接到第一時鐘信號輸入端子CK的第一端部以及連接到輸出端子OUT的第二端部。第一晶體管Ml基于第一節(jié)點(diǎn)Ql的電壓將輸入到第一時鐘信號輸入端子CK的時鐘信號傳輸?shù)捷敵龆俗覱UT。
      [0081]在這樣的實(shí)施例中,第二晶體管M2包括連接到第二時鐘信號輸入端子CKB的柵電極、連接到低電平功率電壓VGL的第一端部以及連接到輸出端子OUT的第二端部。第二晶體管M2基于輸入到第二時鐘信號輸入端子CKB的時鐘信號將低電平功率電壓VGL傳輸?shù)捷敵龆俗覱UT。
      [0082]在這樣的實(shí)施例中,第三晶體管M3包括連接到第二節(jié)點(diǎn)Q2的柵電極、連接到低電平功率電壓VGL的第一端部以及連接到第一節(jié)點(diǎn)Ql的第二端部。第三晶體管M3基于第二節(jié)點(diǎn)Q2的電壓將低電平功率電壓VGL傳輸?shù)降谝还?jié)點(diǎn)Ql。
      [0083]在這樣的實(shí)施例中,第四晶體管M4包括連接到第一正向輸入端子Cr [1-Ι]的柵電極、連接到低電平功率電壓VGL的第一端部以及連接到第二節(jié)點(diǎn)Q2的第二端部。第一先前柵極驅(qū)動塊210[1-l]的柵極信號S[1-1]輸入到第一正向輸入端子Cr[1-1]。第四晶體管M4基于輸入到第一正向輸入端子Cr [1-Ι]的信號將低電平功率電壓VGL傳輸
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