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      一種移位寄存器、柵極集成驅(qū)動(dòng)電路及顯示裝置的制造方法_5

      文檔序號(hào):10158640閱讀:來(lái)源:國(guó)知局
      高,使第三開(kāi)關(guān)晶體管T3、第六開(kāi)關(guān)晶體管T6、第七開(kāi)關(guān)晶體管T7、第十二開(kāi)關(guān)晶體管T12和第十三開(kāi)關(guān)晶體管T13保持導(dǎo)通,參考信號(hào)通過(guò)第六開(kāi)關(guān)晶體管T6傳輸至第四節(jié)點(diǎn)PD_CN1,并通過(guò)第十二開(kāi)關(guān)晶體管T12傳輸至第五節(jié)點(diǎn)PD_CN2 ;VHDl為高電位,第四開(kāi)關(guān)晶體管T4變?yōu)閷?dǎo)通,由于第四開(kāi)關(guān)晶體管T4和第六開(kāi)關(guān)晶體管T6的寬長(zhǎng)比的設(shè)置,第四節(jié)點(diǎn)PD_CN1的電位保持低電位,第五開(kāi)關(guān)晶體管T5保持截止,參考信號(hào)通過(guò)第七開(kāi)關(guān)晶體管T7傳輸至第二節(jié)點(diǎn)roi,第二節(jié)點(diǎn)roi的電位保持低電位,因此第八開(kāi)關(guān)晶體管T8和第九開(kāi)關(guān)晶體管T9保持截止;VHD2為低電位,第十開(kāi)關(guān)晶體管TlO變?yōu)榻刂?,第四?jié)點(diǎn)PD_CN2的電位保持低電位,第十一開(kāi)關(guān)晶體管Tll保持截止,參考信號(hào)通過(guò)第十三開(kāi)關(guān)晶體管T13傳輸至第三節(jié)點(diǎn)TO2,第三節(jié)點(diǎn)TO2的電位保持低電位,因此第十四開(kāi)關(guān)晶體管T14和第十五開(kāi)關(guān)晶體管T15保持截止;時(shí)鐘信號(hào)通過(guò)第三開(kāi)關(guān)晶體管T3傳輸至信號(hào)輸出端Output,驅(qū)動(dòng)信號(hào)輸出端Output的電位變?yōu)楦唠娢弧?br>[0146]在第三階段T3,Input = O, Rstl = O 或 l,Rst2 = LCLK = O, VHDl = 0,VHD2 =
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      [0147]在T3階段,由于Rst2變?yōu)楦唠娢?,第二十開(kāi)關(guān)晶體管T20變?yōu)閷?dǎo)通,參考信號(hào)通過(guò)第二十開(kāi)關(guān)晶體管T20傳輸至信號(hào)輸出端Output,信號(hào)輸出端Output的電位變?yōu)榈碗娢?;由于Input保持低電位,第一開(kāi)關(guān)晶體管Tl保持截止,第十六開(kāi)關(guān)晶體管T16至第十九開(kāi)關(guān)晶體管T19保持截止;在Rstl保持低電位時(shí),第二開(kāi)關(guān)晶體管T2截止,由于時(shí)鐘信號(hào)變?yōu)榈碗娢唬约半娙軨l的作用,第一節(jié)點(diǎn)HJ的電位被拉低,但是仍為高電位,第三開(kāi)關(guān)晶體管T3、第六開(kāi)關(guān)晶體管T6、第七開(kāi)關(guān)晶體管T7、第十二開(kāi)關(guān)晶體管T12和第十三開(kāi)關(guān)晶體管T13導(dǎo)通,參考信號(hào)通過(guò)第六開(kāi)關(guān)晶體管T6傳輸至第四節(jié)點(diǎn)PD_CN1,并通過(guò)第十二開(kāi)關(guān)晶體管T12傳輸至第五節(jié)點(diǎn)PD_CN2 ;VHD1為低電位,第四開(kāi)關(guān)晶體管T4截止,第四節(jié)點(diǎn)PD_CNl的電位為低電位,第五開(kāi)關(guān)晶體管T5保持截止,第二節(jié)點(diǎn)HH的電位保持低電位,第八開(kāi)關(guān)晶體管T8和第九開(kāi)關(guān)晶體管T9保持截止;VHD2為高電位,第十開(kāi)關(guān)晶體管TlO導(dǎo)通,由于第十開(kāi)關(guān)晶體管TlO和第十二開(kāi)關(guān)晶體管T12的寬長(zhǎng)比的設(shè)置,第五節(jié)點(diǎn)PD_CN2的電位為低電位,第十一開(kāi)關(guān)晶體管Tl I截止;參考信號(hào)通過(guò)第十三開(kāi)關(guān)晶體管T13傳輸至第三節(jié)點(diǎn)TO2,第三節(jié)點(diǎn)TO2的電位為低電位,因此第十四開(kāi)關(guān)晶體管T14和第十五開(kāi)關(guān)晶體管T15截止;時(shí)鐘信號(hào)通過(guò)第三開(kāi)關(guān)晶體管T3傳輸至信號(hào)輸出端Output,進(jìn)一步保證信號(hào)輸出端Output的電位為低電位。在Rstl變?yōu)楦唠娢粫r(shí),第二開(kāi)關(guān)晶體管T2變?yōu)閷?dǎo)通,參考信號(hào)通過(guò)第二開(kāi)關(guān)晶體管T2傳輸至第一節(jié)點(diǎn)PU,第一節(jié)點(diǎn)PU的電位變?yōu)榈碗娢?,電容Cl處于放電狀態(tài),并使第三開(kāi)關(guān)晶體管T3、第六開(kāi)關(guān)晶體管T6、第七開(kāi)關(guān)晶體管T7、第十二開(kāi)關(guān)晶體管T12和第十三開(kāi)關(guān)晶體管T13變?yōu)榻刂?。VHD1為低電位,第四開(kāi)關(guān)晶體管T4截止,第四節(jié)點(diǎn)PD_CN1的電位保持低電位,第五開(kāi)關(guān)晶體管T5保持截止,第二節(jié)點(diǎn)PD1的電位保持低電位,第八開(kāi)關(guān)晶體管T8和第九開(kāi)關(guān)晶體管T9保持截止;VHD2為高電位,第十開(kāi)關(guān)晶體管T10變?yōu)閷?dǎo)通,節(jié)點(diǎn)控制信號(hào)通過(guò)第十開(kāi)關(guān)晶體管T10傳輸至第五節(jié)點(diǎn)PD_CN2,第五節(jié)點(diǎn)PD_CN2的電位變?yōu)楦唠娢唬趇^一開(kāi)關(guān)晶體管T11變?yōu)閷?dǎo)通,第三節(jié)點(diǎn)TO2的電位變?yōu)楦唠娢唬谌?jié)點(diǎn)PD2控制第十四開(kāi)關(guān)晶體管T14和第十五開(kāi)關(guān)晶體管T15變?yōu)閷?dǎo)通,參考信號(hào)通過(guò)第十四開(kāi)關(guān)晶體管T14傳輸至第一節(jié)點(diǎn)PU,進(jìn)一步保證第一節(jié)點(diǎn)PU的電位為低電位,參考信號(hào)通過(guò)第十五開(kāi)關(guān)晶體管T15傳輸至信號(hào)輸出端Output,進(jìn)一步保證信號(hào)輸出端Output的電位為低電位。
      [0148]在第四階段T4,Input = 0,Rstl = 1 或 0,Rst2 = 0,CLK = 1 或 0,VHD1 = 1 或0,VHD2 = 0 或 I。
      [0149]在Τ4階段,由于Rst2變?yōu)榈碗娢唬诙_(kāi)關(guān)晶體管T20變?yōu)榻刂?;由于Input保持低電位,第一開(kāi)關(guān)晶體管T1保持截止;在Rstl保持為高電位時(shí),第二開(kāi)關(guān)晶體管T2導(dǎo)通,參考信號(hào)通過(guò)第二開(kāi)關(guān)晶體管T2傳輸至第一節(jié)點(diǎn)PU,第一節(jié)點(diǎn)PU的電位保持低電位;電容C1保持放電狀態(tài),并且使第三開(kāi)關(guān)晶體管T3、第六開(kāi)關(guān)晶體管T6、第七開(kāi)關(guān)晶體管T7、第十二開(kāi)關(guān)晶體管T12和第十三開(kāi)關(guān)晶體管T13保持截止;由于第三開(kāi)關(guān)晶體管T3截止,無(wú)論CLK為高電位還是低電位,對(duì)信號(hào)輸出端Output均無(wú)影響。在Rstl變?yōu)榈碗娢粫r(shí),第二開(kāi)關(guān)晶體管T2截止,第一節(jié)點(diǎn)PU的電位變?yōu)榈碗娢?。在VHD1為高電位時(shí),第四開(kāi)關(guān)晶體管T4導(dǎo)通,節(jié)點(diǎn)控制信號(hào)通過(guò)第四開(kāi)關(guān)晶體管T4傳輸至第四節(jié)點(diǎn)PD_CNl,第四節(jié)點(diǎn)PD.CN1的電位為高電位,第五開(kāi)關(guān)晶體管T5導(dǎo)通,第二節(jié)點(diǎn)roi的電位為高電位,第二節(jié)點(diǎn)PD1控制第八開(kāi)關(guān)晶體管T8和第九開(kāi)關(guān)晶體管T9導(dǎo)通,參考信號(hào)通過(guò)第八開(kāi)關(guān)晶體管T8傳輸至第一節(jié)點(diǎn);參考信號(hào)通過(guò)第九開(kāi)關(guān)晶體管T9傳輸至信號(hào)輸出端Output,使信號(hào)輸出端Output的電位保持為低電位。在VHD1為高電位時(shí)VHD2為低電位,第十開(kāi)關(guān)晶體管T10至第十五開(kāi)關(guān)晶體管T15均處于截止。在VHD2為高電位時(shí),第十開(kāi)關(guān)晶體管T10變?yōu)閷?dǎo)通,節(jié)點(diǎn)控制信號(hào)通過(guò)第十開(kāi)關(guān)晶體管T10傳輸至第五節(jié)點(diǎn)PD_CN2,第五節(jié)點(diǎn)PD_CN2的電位變?yōu)楦唠娢?,第i^一開(kāi)關(guān)晶體管T11導(dǎo)通,第三節(jié)點(diǎn)TO2的電位為高電位,第三節(jié)點(diǎn)PD2控制第十四開(kāi)關(guān)晶體管T14和第十五開(kāi)關(guān)晶體管T15導(dǎo)通,參考信號(hào)通過(guò)第十四開(kāi)關(guān)晶體管T14傳輸至第一節(jié)點(diǎn)PU,保證第一節(jié)點(diǎn)PU的電位為低電位,參考信號(hào)通過(guò)第十五開(kāi)關(guān)晶體管T15傳輸至信號(hào)輸出端Output,保證信號(hào)輸出端Output的電位為低電位。在VHD2為高電位時(shí)VHD1為低電位,第四開(kāi)關(guān)晶體管T4至第九開(kāi)關(guān)晶體管T9均處于截止。
      [0150]之后,移位寄存器一直重復(fù)上述第四階段的工作狀態(tài),直至移位寄存器開(kāi)始接收到下一幀的輸入信號(hào)為止。這樣,在一幀時(shí)間中,從第四階段至下一幀開(kāi)始的時(shí)間段內(nèi),由于第一節(jié)點(diǎn)控制信號(hào)端VHD1和第二節(jié)點(diǎn)控制信號(hào)端VH D2交替輸入節(jié)點(diǎn)控制信號(hào),因此只有在第一節(jié)點(diǎn)控制信號(hào)端VHD1輸入節(jié)點(diǎn)控制信號(hào)時(shí),第四開(kāi)關(guān)晶體管T4、第五開(kāi)關(guān)晶體管T5、第八開(kāi)關(guān)晶體管T8和第九開(kāi)關(guān)晶體管T9處于導(dǎo)通狀態(tài);只有在第二節(jié)點(diǎn)控制信號(hào)端VHD2輸入節(jié)點(diǎn)控制信號(hào)時(shí),第十開(kāi)關(guān)晶體管T10、第十一開(kāi)關(guān)晶體管T11、第十四開(kāi)關(guān)晶體管T14和第十五開(kāi)關(guān)晶體管T15處于導(dǎo)通狀態(tài),從而8個(gè)開(kāi)關(guān)晶體管分為兩組交替處于導(dǎo)通狀態(tài),避免上述8個(gè)開(kāi)關(guān)晶體管在第四階段一直處于導(dǎo)通狀態(tài),進(jìn)而可以延長(zhǎng)其使用壽命ο
      [0151]上述兩個(gè)實(shí)施例均是以N型開(kāi)關(guān)晶體管為例進(jìn)行說(shuō)明,具體對(duì)于P型開(kāi)關(guān)晶體管的工作原理與上述N型開(kāi)關(guān)晶體管的工作原理相似,區(qū)別僅在于P型開(kāi)關(guān)晶體管是低電平導(dǎo)通,在此不再贅述。
      [0152]并且,上述兩個(gè)實(shí)施例均是以第一節(jié)點(diǎn)控制信號(hào)端VHDl和第二節(jié)點(diǎn)控制信號(hào)端VHD2交替輸入節(jié)點(diǎn)控制信號(hào)的周期和時(shí)鐘信號(hào)端輸入的時(shí)鐘信號(hào)的周期相同為例進(jìn)行說(shuō)明的,在具體實(shí)施時(shí),第一節(jié)點(diǎn)控制信號(hào)端VHDl和第二節(jié)點(diǎn)控制信號(hào)端VHD2交替輸入節(jié)點(diǎn)控制信號(hào)的周期可以為I幀至幾百幀,在此不作贅述。
      [0153]基于同一實(shí)用新型構(gòu)思,在移位寄存器的第一復(fù)位控制信號(hào)端Rstl與第二復(fù)位控制信號(hào)端Rst2為同一信號(hào)端Rst時(shí),本實(shí)用新型實(shí)施例還提供了一種柵極集成驅(qū)動(dòng)電路,如圖6所示,包括級(jí)聯(lián)的多個(gè)移位寄存器G0A,第η級(jí)移位寄存器的信號(hào)輸出端與第n+m級(jí)移位寄存器的信號(hào)輸入端相連;第η級(jí)移位寄存器的信號(hào)輸出端分別與第n-m級(jí)移位寄存器的第一復(fù)位控制信號(hào)端Rstl和第二復(fù)位控制信號(hào)端Rst2相連;其中,m為大于或等于I的整數(shù),η為大于m的整數(shù)。圖6以m = 3為例示出了前六個(gè)GOA的連接關(guān)系,其中前三個(gè)GOA的信號(hào)輸入端Input通過(guò)幀起始信號(hào)端STV通入幀起始信號(hào)作為輸入信號(hào)。
      [0154]基于同一實(shí)用新型構(gòu)思,在移位寄存器的第一復(fù)位控制信號(hào)端Rstl與第二復(fù)位控制信號(hào)端Rst2為不同信號(hào)端時(shí),本實(shí)用新型實(shí)施例還提供了一種柵極集成驅(qū)動(dòng)電路,如圖7所示,包括級(jí)聯(lián)的多個(gè)移位寄存器G0A,第η級(jí)移位寄存器的信號(hào)輸出端與第n+m級(jí)移位寄存器的信號(hào)輸入端相連;第η級(jí)移位寄存器的信號(hào)輸出端分別與第n-m-Ι級(jí)移位寄存器的第一復(fù)位控制信號(hào)端和第n-m級(jí)移位寄存器的第二復(fù)位控制信號(hào)端相連;其中,m為大于或等于I的整數(shù),η為大于m的整數(shù);其中,m為大于或等于I的整數(shù),η為大于m的整數(shù)。圖7以m = 3為例示出了前六個(gè)GOA的連接關(guān)系,其中前三個(gè)GOA的信號(hào)輸入端Input通過(guò)幀起始信號(hào)端STV通入幀起始信號(hào)作為輸入信號(hào)。
      [0155]基于同一實(shí)用新型構(gòu)思,在移位寄存器的第一復(fù)位控制信號(hào)端Rstl與第二復(fù)位控制信號(hào)端Rst2為不同信號(hào)端時(shí),本實(shí)用新型實(shí)施例還提供了一種柵極集成驅(qū)動(dòng)電路,如圖8所示,包括級(jí)聯(lián)的多個(gè)移位寄存器G0A,第η級(jí)移位寄存器的信號(hào)輸出端與第n+m級(jí)移位寄存器的信號(hào)輸入端相連;第η級(jí)移位寄存器的信號(hào)輸出端分別與第n-m級(jí)移位寄存器的第一復(fù)位控制信號(hào)端和第n-m+1級(jí)移位寄存器的第二復(fù)位控制信號(hào)端相連;其中,m為大于或等于I的整數(shù),η為大于m的整數(shù)。圖8以m = 3為例示出了前六個(gè)GOA的連接關(guān)系,其中前三個(gè)GOA的信號(hào)輸入端Input通過(guò)幀起始信號(hào)端STV通入幀起始信號(hào)作為輸入信號(hào)。
      [0156]具體地,上述柵極驅(qū)動(dòng)電路中的每個(gè)移位寄存器的具體結(jié)構(gòu)與本實(shí)用新型上述移位寄存器在功能和結(jié)構(gòu)上均相同,重復(fù)之處不再贅述。
      [0157]基于同一實(shí)用新型構(gòu)思,本實(shí)用新型實(shí)施例還提供了一種顯示裝置,包括上述的柵極集成驅(qū)動(dòng)電路,通過(guò)該柵極集成驅(qū)動(dòng)電路為顯示裝置中陣列基板上的各柵線(xiàn)提供掃描信號(hào),其具體實(shí)施可參見(jiàn)上述柵極集成驅(qū)動(dòng)電路的描述,相同之處不再贅述。
      [0158]本實(shí)用新型實(shí)施例提供的一種移位寄存器、柵極集成驅(qū)動(dòng)電路及顯示裝置,包括:輸入模塊,第一復(fù)位模塊,輸出模塊,第一下拉控制模塊,以及第二下拉控制模塊。其中,輸入模塊用于在輸入信號(hào)端輸入有效脈沖信
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